| 类型 | 描述 |
|---|
| 安装方式 | Surface Mount |
| 引脚数 | 14 Pin |
| 电源电压 | 1.65V ~ 3.60V |
| 封装 | VQFN-14 |
| 输出接口数 | 4 Output |
| 电路数 | 4 Circuit |
| 通道数 | 4 Channel |
| 针脚数 | 14 Position |
| 位数 | 4 Bit |
| 传送延迟时间 | 4.80 ns |
| 电压波节 | 3.30 V, 2.70 V, 2.50 V, 1.80 V |
| 功耗 | 500 mW |
| 输出电流驱动 | -1.00 mA |
| 输入数 | 4 Input |
| 工作温度(Max) | 125 ℃ |
| 工作温度(Min) | -40 ℃ |
| 耗散功率(Max) | 500 mW |
| 电源电压 | 1.65V ~ 3.6V |
| 电源电压(Max) | 3.6 V |
| 电源电压(Min) | 1.65 V |
| 类型 | 描述 |
|---|
| 产品生命周期 | Active |
| 包装方式 | Tape & Reel (TR) |
| 长度 | 3.65 mm |
| 宽度 | 3.65 mm |
| 高度 | 0.95 mm |
| 工作温度 | -40℃ ~ 125℃ (TA) |
74LVC 系列反相器和缓冲器，德州仪器
●德州仪器的 74LVC 系列低功率 CMOS 逻辑集 IC 的一系列反相器和缓冲器。 74LVC 系列使用硅门 CMOS 技术，设计用于在 3.3V 时工作，与 5V 系统相比，允许功耗显著降低。
●工作电压：1.65 至 3.6V
●5V 容差的输入
●兼容性：输入 LVTTL/TTL，输出 LVCMOS
●按 JESD 17标准，闩锁效应性能超过 250 mA
●ESD 保护超过 JESD 22
●### 74LVC 系列
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98 页 / 1.47 MByte
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TEXAS INSTRUMENTS SN74LVC125APWR 缓冲器/线路驱动器, 非反相, 3态, 4门, 1输入, 1.65V至3.6V, TSSOP-14
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TEXAS INSTRUMENTS SN74LVC125ADR 缓冲器/线路驱动器, 非反相, 3态, 4门, 1输入, 1.65V至3.6V, SOIC-14
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具有三态输出的增强型产品四路总线缓冲门 14-SOIC -55 to 125
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74LVC 系列反相器和缓冲器，德州仪器德州仪器的 74LVC 系列低功率 CMOS 逻辑集 IC 的一系列反相器和缓冲器。 74LVC 系列使用硅门 CMOS 技术，设计用于在 3.3V 时工作，与 5V 系统相比，允许功耗显著降低。工作电压：1.65 至 3.6V 5V 容差的输入 兼容性：输入 LVTTL/TTL，输出 LVCMOS 按 JESD 17标准，闩锁效应性能超过 250 mA ESD 保护超过 JESD 22 ### 74LVC 系列
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74LVC 系列反相器和缓冲器，德州仪器德州仪器的 74LVC 系列低功率 CMOS 逻辑集 IC 的一系列反相器和缓冲器。 74LVC 系列使用硅门 CMOS 技术，设计用于在 3.3V 时工作，与 5V 系统相比，允许功耗显著降低。工作电压：1.65 至 3.6V 5V 容差的输入 兼容性：输入 LVTTL/TTL，输出 LVCMOS 按 JESD 17标准，闩锁效应性能超过 250 mA ESD 保护超过 JESD 22 ### 74LVC 系列
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74LVC 系列反相器和缓冲器，德州仪器德州仪器的 74LVC 系列低功率 CMOS 逻辑集 IC 的一系列反相器和缓冲器。 74LVC 系列使用硅门 CMOS 技术，设计用于在 3.3V 时工作，与 5V 系统相比，允许功耗显著降低。工作电压：1.65 至 3.6V 5V 容差的输入 兼容性：输入 LVTTL/TTL，输出 LVCMOS 按 JESD 17标准，闩锁效应性能超过 250 mA ESD 保护超过 JESD 22 ### 74LVC 系列
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缓冲器和线路驱动器 Quad Bus Buffer Gate
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四路总线缓冲器闸具有三态输出 QUADRUPLE BUS BUFFER GATE WITH 3-STATE OUTPUTS
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TEXAS INSTRUMENTS SN74LVC125AD. 芯片, 74LVC 逻辑 [ROHS Substitute: 1102975]
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